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本科生（五） 一、选择题（每小题2分，共30分）   1  某机字长64位，1位符号位，63位表示尾数，若用定点整数表示，则最大正整数位（  ）。     A  +(263-1)    B  +(264-1)    C  -(263-1)    D  -(264-1)   2  请从下面浮点运算器中的描述中选出两个描述正确的句子（  ）。     A  浮点运算器可用两个松散连接的定点运算部件一阶码和尾数部件来实现。     B  阶码部件可实现加，减，乘，除四种运算。     C  阶码部件只进行阶码相加，相减和比较操作。     D  尾数部件只进行乘法和除法运算。   3  存储单元是指（  ）。     A  存放1个二进制信息位的存储元     B  存放1个机器字的所有存储元集合     C  存放1个字节的所有存储元集合     D  存放2个字节的所有存储元集合   4  某机字长32位，存储容量1MB，若按字编址，它的寻址范围是（  ）。     A  0—1M    B  0—512KB    C  0—56K    D  0—256KB   5  用于对某个寄存器中操作数的寻址方式为（  ）。     A  直接    B  间接    C  寄存器直接    D  寄存器间接   6  程序控制类的指令功能是（  ）。 A  进行算术运算和逻辑运算 B  进行主存与CPU之间的数据传送 C  进行CPU和I/O设备之间的数据传送     D  改变程序执行的顺序   7  指令周期是指（  ）。 A  CPU从主存取出一条指令的时间 B  CPU执行一条指令的时间 C  CPU从主存取出一条指令加上执行一条指令的时间     D  时钟周期时间   8  描述当代流行总线结构中基本概念不正确的句子是（  ）。 A  当代流行的总线不是标准总线 B  当代总线结构中，CPU和它私有的cache一起作为一个模块与总线相连     C  系统中允许有一个这样的CPU模块   9  CRT的颜色为256色，则刷新存储器每个单元的字长是（  ）。     A  256位    B  16位    C  8位    D  7位   10  发生中断请求的条件是（  ）。 A  一条指令执行结束 B  一次I/O操作结束 C  机器内部发生故障     D  一次DMA操作结束   11  中断向量地址是（  ）。 A  子程序入口地址 B  中断服务程序入口地址 C  中断服务程序入口地址指示器     D  例行程序入口地址   12  IEEE1394所以能实现数据传送的实时性，是因为（  ）。 A  除异步传送外，还提供同步传送方式     B  提高了时钟频率 C  除优先权仲裁外，还提供均等仲裁,紧急仲裁两种总线仲裁方式     D  能够进行热插拔   13  直接映射cache的主要优点是实现简单。这种方式的主要缺点是（  ）。 A  它比其他cache映射方式价格更贵     B  如果使用中的2个或多个块映射到cache同一行，命中率则下降 C  它的存取时间大于其它cache映射方式     D  cache中的块数随着主存容量增大而线性增加   14  虚拟存储器中段页式存储管理的特性为（  ）。 A  空间浪费大，存储共享不易，存储保护容易，不能动态连接     B  空间浪费小，存储共享容易，存储保护不易，不能动态连接 C  空间浪费大，存储共享不易，存储保护容易，能动态连接     D  空间浪费小，存储共享容易，存储保护容易，能动态连接   15  安腾处理机的指令中，操作数寻址采用（  ）。     A  R-R-S型    B  R-R-R型    C  R-S-S型    D  S-S-S型 二、简答题（每小题8分，共16分）   1  画图说明现代计算机系统的层次结构。   2  CPU中有哪几类主要寄存器？用一句话回答其功能。 三、计算题（12分）     CPU执行一段程序时，cache完成存取的次数为2420次，主存完成的次数为80次，已知cache存储周期为40ns，主存存储周期为200ns，求cache/主存系统的效率和平均访问时间。 四、设计题（14分）     某机器单字长指令为32位，共有40条指令，通用寄存器有128个，主存最大寻址空间为64M。寻址方式有立即寻址、直接寻址、寄存器寻址、寄存器间接寻址、基值寻址、相对寻址六种。请设计指令格式，并做必要说明。 五、证明题（12分） 一条机器指令的指令周期包括取指（IF）、译码（ID）、执行（EX）、写回（WB）四个过程段，每个过程段1个时钟周期T完成。 　　先段定机器指令采用以下三种方式执行：①非流水线（顺序）方式，②标量流水线方式，③超标量流水线方式。 　　请画出三种方式的时空图，证明流水计算机比非流水计算机具有更高的吞吐率。 六、设计题（16分） CPU的数据通路如图1所示。运算器中R0～R3为通用寄存器，DR为数据缓冲寄存器，PSW为状态字寄存器。D-cache为数据存储器，I-cache为指令存储器，PC为程序计数器（具有加1功能），IR为指令寄存器。单线箭头信号均为微操作控制信号（电位或脉冲），如LR0表示读出R0寄存器，SR0表示写入R0寄存器。 　　机器指令“STO R1,(R2)”实现的功能是：将寄存器R1中的数据写入到以（R2）为地址的数存单元中。请画出该存数指令周期图，并在CPU周期框外写出所需的微操作控制信号。（一个CPU周期含T1～T4四个时钟信号，寄存器打入信号必须注明时钟序号）